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Mémoires ECC


xenonx

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C'est tout à fait vrai : la correction d'erreur induit un poil de latence.

Par contre pour les serveurs c'est majeur d'être sur qu'il y a le moins d'erreurs possible dans la gestion des opérations. Imaginez un erreur pas dans le sens qui vous arrange sur l'ordinateur de la banque qui gère votre compte ... :pleure:

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Ce n'est pas une correction....mais une simple detection d'erreur basé sur un controle de parité (...voir même un calcul de FCS sur certains modéle haut de gamme).

:p

ECC : Error Checking and Correcting

Le nom de la RAM me parraissait pourtant clair :

Verification ET Correction d'Erreur

:mad2:

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Et oui......mais non. :p

En cas d'erreur...le signal corrompu est tout simplement perdu.

Ensuite le systéme recalcul cette même donné et la renvoi (c'est ça le "correction"....). Action effectué par le CPU et non par le mémoire....donc rien à voire avec la latence plus importante de la RAM ECC......

:mad2:

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[...]des mémoires ECC (Error Checking and Correcting ou Error Correction Code). Cette technologie utilise plusieurs bits de contrôle (parité) pour la vérification des données en mémoire. Ces mémoires sont auto-correctives. Cette mémoire peut détecter 4 erreurs et en corriger une sans arrêter le système. Un nouveau type de mémoires avec correction d'erreur AECC (Advanced Error Correcting Code) peut détecter 4 erreurs et en corriger 4 sans arrêter le système. Forcément, ces mécanismes ralentissent un peu le système.

Qui croire ? :p

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Il faut préciser sur l'adressage des données, pas que les données, il faut bien reconnaître et se souvenir que le type d'accès est aléatoire et que faire le ménage prendra un peu de temps, un peu comme sur un disque dur l'info est fragmentéé et on imagine aisément qu'à l'ouverture d'un fichier, nécessairement fractionner, qu'un dispositif prévu pour vérifier que tout les segments constitutifs du fichier sont valides, avant sont ouverture, demande un délai sup, non?

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Il faut préciser sur l'adressage des données, pas que les données, il faut bien reconnaître et se souvenir que le type d'accès est aléatoire et que faire le ménage prendra un peu de temps, un peu comme sur un disque dur l'info est fragmentéé et on imagine aisément qu'à l'ouverture d'un fichier, nécessairement fractionner, qu'un dispositif prévu pour vérifier que tout les segments constitutifs du fichier sont valides, avant sont ouverture, demande un délai sup, non?

Là je suis d'accord tatar33.

Même si les controles de parité sont trés rapide (c'est un simpe comptage de bit) cela prend quand même un peu de temps. Surtout que dans le cas de la RAM ECC....il ce fait sur un octet (8bits).

--> capten

Ta cource STP.

Un tel systéme est impossible. Cela voudrais dire que la RAM peu décrypter les infos sctockées!! Donc un systéme complexe "intéligent"......

Dans le cas d'un comtrole de parité (comme les liaison RS232 par ex)...c'est une simple vérification. Bref une simple régle à appliqué.

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Sur le net j'ai trouvé plusieurs info.

Le RAM registered applique un simple controle de parité.

La RAM ECC utilise en plus un algorithme de vérification. Donc elle doit pouvoire corrigé automatiquement certaines erreur courante.

--------------------------------------------------------------------------------------------

Donc c'est une correction assez limité (en cas d'erreur de donné....l'info est bien perdu et recalculé...comme de la RAM registered)....mais elle est bien autocorrectrice dans certain cas.

:chinois:

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La RAM ECC utilise en plus un algorithme de vérification. Donc elle doit pouvoire corrigé  automatiquement certaines erreur courante.

Avec les codes de hoffman, on peut effectivement corriger certaines erreurs avec des tests logiques pas trop compliqués (pas beacoup de bits touchés) mais on peut pas corriger toutes les erreurs.

C'est de la même famille que la réparation d'archives de WinRar.

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Il est bien écrit ici que la  mémoire ECC peut détecter et corriger les erreurs :

La technologie ECC classique peut détecter et corriger des erreurs

Je pense que x86-secret est un site de confiance...

Attention il y a 2 types différents d'ECC !

ECC (Error-Correction Code) = Détecter des erreurs mais corriger quelques erreurs (incomplet)

AECC (Advanced Error-Correction Code) = Détecter des erreurs et corriger des erreurs (plus complet par rapport ECC)

Sources :

Définition ECC

Définition AECC

:8

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[...]des mémoires ECC  (Error Checking and Correcting ou Error Correction Code). Cette technologie utilise plusieurs bits de contrôle (parité) pour la vérification des données en mémoire. Ces mémoires sont auto-correctives. Cette mémoire peut détecter 4 erreurs et en corriger une sans arrêter le système. Un nouveau type de mémoires avec correction d'erreur AECC (Advanced Error Correcting Code) peut détecter 4 erreurs et en corriger 4 sans arrêter le système. Forcément, ces mécanismes ralentissent un peu le système.

-->X-Systeme.

"capten" a déja mit ces définitions.... (en plus d'être sourd tu est aveugle!! :keskidit::francais: ). :oops:

Plus sérieusement, la RAM AECC doit fonctionné avec de la même maniére que l'ECC...donc avec une parité est un algorithme de vérif (...donc limité). Je doute qu'elle puisse corrigé tous les types d'erreurs.....

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-->X-Systeme.

"capten" a déja mit ces définitions.... (en plus d'être sourd tu est aveugle!! :iloveyou::vomi1: ). :yes:

Plus sérieusement, la RAM AECC doit fonctionné avec de la même maniére que l'ECC...donc avec une parité est un algorithme de vérif (...donc limité). Je doute qu'elle puisse corrigé tous les types d'erreurs.....

Je lis tout mais c'est parfois quelques posts "sautés" tout seul quand je lis...

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